GeoSELECT.ru



Компьютеры / Реферат: Структурная схема ЭВМ (Компьютеры)

Космонавтика
Уфология
Авиация
Административное право
Арбитражный процесс
Архитектура
Астрология
Астрономия
Аудит
Банковское дело
Безопасность жизнедеятельности
Биология
Биржевое дело
Ботаника
Бухгалтерский учет
Валютные отношения
Ветеринария
Военная кафедра
География
Геодезия
Геология
Геополитика
Государство и право
Гражданское право и процесс
Делопроизводство
Деньги и кредит
Естествознание
Журналистика
Зоология
Инвестиции
Иностранные языки
Информатика
Искусство и культура
Исторические личности
История
Кибернетика
Коммуникации и связь
Компьютеры
Косметология
Криминалистика
Криминология
Криптология
Кулинария
Культурология
Литература
Литература : зарубежная
Литература : русская
Логика
Логистика
Маркетинг
Масс-медиа и реклама
Математика
Международное публичное право
Международное частное право
Международные отношения
Менеджмент
Металлургия
Мифология
Москвоведение
Музыка
Муниципальное право
Налоги
Начертательная геометрия
Оккультизм
Педагогика
Полиграфия
Политология
Право
Предпринимательство
Программирование
Психология
Радиоэлектроника
Религия
Риторика
Сельское хозяйство
Социология
Спорт
Статистика
Страхование
Строительство
Схемотехника
Таможенная система
Теория государства и права
Теория организации
Теплотехника
Технология
Товароведение
Транспорт
Трудовое право
Туризм
Уголовное право и процесс
Управление
Физика
Физкультура
Философия
Финансы
Фотография
Химия
Хозяйственное право
Цифровые устройства
Экологическое право
   

Реферат: Структурная схема ЭВМ (Компьютеры)



ОГЛАВЛЕНИЕ

1. СТРУКТУРНАЯ СХЕМА ЭВМ. ПОКОЛЕНИЯ ЭВМ 3
2. СИСТЕМЫ СЧИСЛЕНИЯ. 4
3. АРИФМЕТИЧЕСКИЕ ДЕЙСТВИЯ НАД ДВОИЧНЫМИ ЧИСЛАМИ 6
3.1 Вычитание с применением обратного кода. 6
3.2 Образование дополнительного кода. 7
4. УЗЛЫ ЭВМ. 7
5. СУММАТОР 8
6. ПОСЛЕДОВАТЕЛЬНЫЙ СУММАТОР 9
7. АРИФМЕТИКО - ЛОГИЧЕСКОЕ УСТРОЙСТВО (АЛУ) 10
8. ДЕШИФРАТОР 12
9. ПРЕОБРАЗОВАТЕЛИ С ЦИФРОВОЙ ИНДИКАЦИЕЙ 14
10. ПРЕОБРАЗОВАТЕЛЬ КОДА 8421 В 2421 15
11. ПРОГРАММИРУЕМАЯ ЛОГИЧЕСКАЯ МАТРИЦА (ПЛМ) 16
12. НАКАПЛИВАЮЩИЙ СУММАТОР 17
13. ОСНОВНЫЕ МИКРОПРОЦЕССОРНЫЕ КОМПЛЕКТЫ 18
14. ТИПОВАЯ СТРУКТУРА ОБРАБАТЫВАЮЩЕЙ ЧАСТИ МП 21
15. МИКРО ЭВМ НА БАЗЕ МП К580 22
16. ФОРМАТЫ КОМАНД И СПОСОБЫ АДРЕСАЦИИ 24
17. ЦЕНТРАЛЬНЫЙ ПРОЦЕССОРНЫЙ ЭЛЕМЕНТ К580 26
18. СИСТЕМА СБОРА ДАННЫХ НА БАЗЕ МП К580 27
19. ЦЕНТРАЛЬНЫЙ ПРОЦЕССОРНЫЙ ЭЛЕМЕНТ (ЦПЭ) К589 29
20. БЛОК МИКРОПРОГРАММНОГО УПРАВЛЕНИЯ (БМУ). 30
21. СТРУКТУРНАЯ СХЕМА И ПРИНЦИП ДЕЙСТВИЯ БЛОКА
МИКРОПРОГРАММНОГО УПРАВЛЕНИЯ (БМУ) 32
22. БЛОК ПРИОРИТЕТНОГО ПРЕРЫВАНИЯ (БПП) 34
23. СХЕМА УСКОРЕННОГО ПЕРЕНОСА (СУП) 35
24. СХЕМА ОДНОРАЗРЯДНОГО СУММАТОРА С ФОРМИРОВАНИЕМ
ЦИФРЫ ПЕРЕНОСА В СУП 36
25. ОРГАНИЗАЦИЯ ПАМЯТИ ЭВМ 37
26. ПОСТОЯННЫЕ ЗАПОМИНАЮЩИЕ УСТРОЙСТВА (ПЗУ) 39
27. ВНЕШНИЕ ЗАПОМИНАЮЩИЕ УСТРОЙСТВА (ВЗУ) 40
27.1 Метод записи без возврата к нулю 41
27.2 Фазовая модуляция. 41
27.3 Частотная модуляция. 42
28. УСТРОЙСТВА ВВОДА - ВЫВОДА ИНФОРМАЦИИ 42
29. ВЫВОД ИНФОРМАЦИИ НА ДИСПЛЕЙ 43
30. ВЫВОД ИНФОРМАЦИИ НА ТЕЛЕТАЙП 45
31. ИНТЕРФЕЙС 46
32. ОБМЕН ДАННЫМИ МЕЖДУ ОПЕРАТИВНОЙ ПАМЯТЬЮ И
ПЕРИФЕРИЙНЫМИ УСТРОЙСТВАМИ (ПУ) 48
33. ОБМЕН ДАННЫМИ ПО ПРЕРЫВАНИЯМ 51
34. СПЕЦИАЛИЗИРОВАННЫЕ УСТРОЙСТВА ИНТЕРФЕЙСА. АЦП 53
35. АЦП С ОБРАТНОЙ СВЯЗЬЮ (ОС) 54
36. АЦП СЛЕДЯЩЕГО ТИПА. 55
37. ЦАП С СУММИРОВАНИЕМ НАПРЯЖЕНИЯ НА ОПЕРАЦИОННОМ
УСИЛИТЕЛЕ (ОУ). 55
38. ПРИМЕНЕНИЕ МИКРО ЭВМ В СИСТЕМАХ АВТОМАТИЗИРОВАННОГО
УПРАВЛЕНИЯ (САУ) 56
39. СХЕМА СУММИРОВАНИЯ НАПРЯЖЕНИЯ НА АТТЕНЮАТОРЕ
СОПРОТИВЛЕНИЙ 58
40. ПРИМЕНЕНИЕ МИКРО ЭВМ В ПРИБОРАХ (СПЕКТРОФОТОМЕТР) 58
41. ПРОГРАММНОЕ ОБЕСПЕЧЕНИЕ (ПО) ЭВМ. 60
42. ОПЕРАЦИОННАЯ СИСТЕМА ЭВМ 61
43. МИКРОПРОЦЕССОРНЫЙ КОМПЛЕКТ К 1804. 62
44. АССЕМБЛЕР К580 66



1. СТРУКТУРНАЯ СХЕМА ЭВМ. ПОКОЛЕНИЯ ЭВМ


Создано 4 поколения ЭВМ:
1. 1946 г. создание машины ЭНИАК на электронных лампах.
Запоминающие устройства (ЗУ) были построены на электронных. лампах,
электронно - лучевых трубках (ЭЛТ) и линиях задержки.
2. 60-е годы. ЭВМ построены на транзисторах, ЗУ на транзисторах,
линиях задержки и ферритовых сердечниках.
3. 70-е годы. ЭВМ построены на интегральных микросхемах (ИМС). ЗУ на
ИМС.
4. Начало создаваться с 1971 г. с изобретением микропроцессора (МП).
Построены на основе больших интегральных схем (БИС) и сверх БИС (СБИС).
Пятое поколение ЭВМ строится по принципу человеческого мозга,
управляется голосом, используется новая технология на основе арсенида
галлия.
ЭВМ предназначены для обработки информации и отображения результатов
обработки. Для решения задачи должна быть написана программа.
[pic]
Во время решения задачи программа и операнды (числа, над которыми
производится операции) находятся в оперативной памяти (ОЗУ). Быстродействие
ОЗУ соизмеримо с быстродействием АЛУ. В процессе решения задачи АЛУ
постоянно взаимодействует с ОЗУ, передавая в ОЗУ промежуточные и конечные
результаты и получая из ОЗУ операнды действия всех частей ЭВМ при решении
задачи осуществляется под воздействием управляющих сигналов, вырабатываемых
устройством управления в соответствии с программой, записанной в ОЗУ.
ПЗУ предназначено для хранения стандартных программ, таких как sin и
cos, констант , е.
Существует еще сверх ОЗУ (СОЗУ), которое обладает малым объемом и
высоким быстродействием. СОЗУ применяется для кратковременного хранения
операндов и промежуточных результатов.
Качество ЭВМ определяется: объемом ОЗУ (т.е. количеством одновременно
хранимых в ОЗУ двоичных слов); быстродействием, определяемым количеством
операций в сек. После выполнения задачи, программа и результаты через
устройство вывода записываются во внешнее ЗУ. В качестве внешних ЗУ
используются магнитная лента, гибкий магнитный диск, магнитный барабан,
перфолента, перфокарты. Программа вводится в ОЗУ с внешних ЗУ или с
клавиатуры через устройство ввода.


2. СИСТЕМЫ СЧИСЛЕНИЯ.


Основанием системы счисления называют. число, в виде степеней
которого может быть записано любое число в данной системе счисления.
Системы счисления, применяемые в ЭВМ, ориентированы на двоичную систему,
т.к. основой ЭВМ является триггер, имеющий два устойчивых состояния.
В десятичной системе счисления основанием является. 10 и для записи
чисел используют символы 0...9.В двоичной системе основанием является. 2.
Для записи чисел используются символы 0 и 1.
Для перевода числа из десятичной системы в двоичную надо
последовательно делить на два и результат записывать справа налево, начиная
с последнего частного, включая остатки от деления.
Таблица 1
|10 |2 |8 |16 |
|0 |00 |0 |0 |
|1 |01 |1 |1 |
|2 |10 |2 |2 |
|3 |11 |3 |3 |
|4 |100 |4 |4 |
|5 |101 |5 |5 |
|6 |110 |6 |6 |
|7 |111 |7 |7 |
|8 |1000 |10 |8 |
|9 |1001 |11 |9 |
|10 |1010 |12 |A |
|11 |1011 |13 |B |
|12 |1100 |14 |C |
|13 |1101 |15 |D |
|14 |1110 |16 |E |
|15 |1111 |17 |F |
|16 |10000 |20 |10 |

В восьмеричной системе основанием является. 8. Для записи чисел
используют символы 0...7. Любое число может быть записано как сумма
степеней 8. Для перевода числа из десятичной системы в восьмеричную надо
последовательно делить на 8.
Для перевода числа из двоичной системы в восьмеричную, нужно
отсчитывать справа налево по три разряда двоичного числа и записывать
каждую группу из трех разрядов с помощью символов 0...7.
Основанием в шестнадцатеричной системе является 16, для записи чисел
используются символы 0...9 и A...F. Для перевода из десятичной системы в
шестнадцатеричную, надо последовательно делить на 16:
В любой системе счисления ее основание записывается как 10. Для
перевода числа из двоичной системы в шестнадцатеричную, нужно отсчитывать
справа налево по 4 разряда двоичного числа и записывать каждую группу
разрядов с помощью символов из Таблицы 1, в которой представлены
соотношения между числами в различных системах счисления.


3. АРИФМЕТИЧЕСКИЕ ДЕЙСТВИЯ НАД ДВОИЧНЫМИ ЧИСЛАМИ


В принципе машина умеет только суммировать. Все остальные
арифметические действия сводятся к арифметической операции суммирования,
логическим операциям сдвига при умножении и делении. Вычитание заменяется
суммированием в дополнительном или обратном коде.
Суммирование производится по правилам суммирования по модулю 2.

0 0 = 0
0 1 = 1
1 0 = 1
1 1 = 0 и 1 перенос в старший разряд.


3.1 Вычитание с применением обратного кода.


Прямой код положительного числа совпадает с его обратным и
дополнительным кодом. Обратный код отрицательного числа образуется
инверсией единиц в нули и нулей в единицы. Если кол-во разрядов
уменьшаемого и вычитаемого разное, то слева дописываются нули в прямом коде
так, чтобы кол-во разрядов было одинаково.
Содержимое знаковых разрядов :
0.- для полож.
1.- для отриц.
Если результат получается отрицательный, его нужно преобразовать в
прямой код; содержимое знакового разряда не инвертируется. Если в знаковом
разряде наблюдается переполнение разрядной сетки, то единица переполнения
добавляется к младшему разряду, а затем происходит переход к прямому коду.



3.2 Образование дополнительного кода.


Дополнительный код образуется из прямого кода инверсией и добавлением
единицы к младшему разряду. Если результат получился отрицательным, то
чтобы получить прямой код необходимо осуществить инверсию, а затем добавить
единицу к младшему разряду. Единица переполнения знакового разряда при
использовании дополнительного кода отбрасывается.


4. УЗЛЫ ЭВМ.


Узлы ЭВМ классифицируются на :
1. комбинационные - это узлы, выходные сигналы которых определяются
только сигналом на входе, действующим в настоящий момент времени
(дешифратор). Выходной сигнал дешифратора зависит только от двоичного кода,
поданного на вход в настоящий момент времени. Комбинационные узлы называют
также автоматами без памяти.
2. последовательностные (автоматы с памятью) - это узлы, выходной
сигнал которых зависит не только от комбинации входных. сигналов,
действующих в настоящий момент времени, но и от предыдущего состояния узла
(счетчик).
3. программируемые узлы функционируют в зависимости от того, какая
программа в них записана. Например, программируемая логическая матрица
(ПЛМ), которая в зависимости от прожженной в ней программы может выполнять
функции сумматора, дешифратора, ПЗУ.



5. СУММАТОР


[pic]

Сумматор может быть построен как комбинационная схема -
последовательный сумматор и как
последовательностная схема -
накапливающий сумматор. Сумматор осуществляет cуммирование цифр разрядов
слагаемых и цифр переноса по правилам сложения по модулю 2. Работа
сумматора строго регламентирована в соответствии с таблицей:


| ai |bi |Pi |Si |Pi+1 |
|0 |0 |0 |0 |0 |
|0 |0 |1 |1 |0 |
|0 |1 |0 |1 |0 |
|0 |1 |1 |0 |1 |
|1 |0 |0 |1 |0 |
|1 |0 |1 |0 |1 |
|1 |1 |0 |0 |1 |
|1 |1 |1 |1 |1 |


6. ПОСЛЕДОВАТЕЛЬНЫЙ СУММАТОР


[pic]
Последовательный сумматор осуществляет суммирование слагаемых и цифр
переноса поразрядно, начиная с младшего разряда. Основой его схемы является
одноразрядный сумматор. Суммирование производится в одноразрядном сумматоре
SM. Цифры i-того разряда слагаемого и цифра переноса из младшего разряда
передаются на вход сумматора одновременно с приходом тактового импульса.
Регистры 1 и 2 используются для приема и хранения цифр i-того разряда
слагаемых. В D - триггере хранится цифра переноса из младшего разряда.
Регистр 3 принимает и хранит цифру i-того суммы. С приходом тактового
импульса из регистров 1, 2 и D - триггера разряда слагаемых и цифра
переноса поступает на вход одноразрядного сумматора. Одновременно регистр 3
освобождается для приема цифры суммы.

[pic]

В параллельном сумматоре все разряды операндов суммируются
одновременно, но быстродействие снижается за счет времени передачи цифры
переноса из младшего разряда.



7. АРИФМЕТИКО - ЛОГИЧЕСКОЕ УСТРОЙСТВО (АЛУ)



АЛУ предназначено для выполнения арифметических и логических
операций над операндами. АЛУ классифицируются следующим образом:
1. По способу действий над операндами. Бывают АЛУ последовательного и
параллельного действия. В последовательных АЛУ действия над операндами
производятся последовательно разряд за разрядом начиная с младшего. В
параллельных АЛУ все разряды операндов обрабатываются одновременно.
2. По виду обрабатываемых чисел АЛУ могут производить операции над
двоичными числами с фиксированной или плавающей запятой и над двоично-
десятичными числами.
Каждая десятичная цифра записывается четырьмя разрядами двоичного
кода.
1971
0001 1001 0111 0001
АЛУ при действии над двоично-десятичными числами должны содержать
схему десятичной коррекции. Схема десятичной коррекции преобразует
полученный результат таким образом, чтобы каждый двоично-десятичный разряд
не содержал цифру больше 9.
При записи числа с фиксированной запятой запятая фиксируется после
младшего разряда, если число целое, и перед старшим, если число меньше 1.
При записи чисел с плавающей запятой выделяется целая часть, которая
называется мантиссой, и показатель степени, который характеризует положение
запятой.
37 и 0.37 - с фиксированной запятой
37*10^-2 - с плавающей запятой
3. По организации действий над операндами различают блочные и
многофункциональные АЛУ
В блочных АЛУ отдельные блоки предназначены для действий над двоично-
десятичными числами, отдельно для действий над числами с фиксированной
запятой, отдельно с плавающей запятой.
В многофункциональных АЛУ одни и те же блоки обрабатывают числа с
фиксированной запятой, плавающей запятой и двоично-десятичные числа.
Многофункциональное АЛУ
[pic]
Клапаны К1 и К2 объединяют сумматоры 1,2 и 3 для действий над числами с
фиксированной запятой.
Для действий над числами с плавающей запятой клапан К2 объединяет
сумматоры 2 и 3 для обработки мантисс, а клапан К1 отсоединяет первый
сумматор от второго. Сумматор 1 обрабатывает порядки.
4. По структуре АЛУ бывают с непосредственными связями и многосвязными.
АЛУ с непосредственной связью В многосвязных АЛУ входы и выходы регистров
приемников и источников информации подсоединяются к одной шине.
Распределение входных и выходных сигналов происходит под действием
управляющих сигналов.
[pic]
В АЛУ с непосредственной связью вход регистра приемника связан с
выходом регистра источника операндов и регистра, в котором происходит
обработка.
Например, в этой схеме суммирование происходит так: операнды подаются
в регистр 1. Регистр 2 является накапливающим сумматором или автоматом с
памятью. Он суммирует слагаемые, поступающие в разные моменты времени и
передает результат в регистр 3.
Умножение в этом АЛУ происходит так: множимое помещают в регистр 4,
множитель - в регистр 1. Регистры 2 и 3 являются кроме того сдвигающими
регистрами. В зависимости от содержимого разряда множителя, множимое
сдвигается на один разряд, если множитель содержит 1, и на два, если
множитель содержит 0. Эти частные произведения суммируются в регистре 2.


8. ДЕШИФРАТОР


Дешифратор предназначен для преобразования двоичного кода на входе в
управляющий сигнал на одном из выходов. Если входов n то выходных шин
должно быть N = 2^n.

| X1 |X2 |X3 |Z0 |Z1 |Z2 |Z3 |Z4 |Z5 |Z6 |Z7 |
|0 |0 |0 |1 |0 |0 |0 |0 |0 |0 |0 |
|0 |0 |1 |0 |1 |0 |0 |0 |0 |0 |0 |
|0 |1 |0 |0 |0 |1 |0 |0 |0 |0 |0 |
|0 |1 |1 |0 |0 |0 |1 |0 |0 |0 |0 |
|1 |0 |0 |0 |0 |0 |0 |1 |0 |0 |0 |
|1 |0 |1 |0 |0 |0 |0 |0 |1 |0 |0 |
|1 |1 |0 |0 |0 |0 |0 |0 |0 |1 |0 |
|1 |1 |1 |0 |0 |0 |0 |0 |0 |0 |1 |


В зависимости от количества разрядов входного числа и от количества
входов элементов, на которых построен дешифратор. Дешифраторы могут быть
линейные, у которых все переменные Х1, Х2, Х3 подаются на вход
одновременно.
[pic]
Их быстродействие больше, но более 3-х переменных одновременно подать
нельзя, поэтому чаще применяются многокаскадные дешифраторы. Количество
элементов в каждом следующем разряде больше, чем в предыдущем.
На вход первого каскада подается один слог, на вход следующего
каскада второй слог и результаты коньюнкций, произведенных в первом
каскаде.
Простейший линейный дешифратор можно построить на диодной матрице:
[pic]

В этой схеме используется отрицательная логика. При подаче "1" на
анод диода он закрывается. Если закрыты все 3 диода, подсоединенные к одной
гориз. линии то на этой линии потенциал -Е, соответствующий уровню "1".
Многокаскадный дешифратор можно организовать вот таким образом:
[pic]

Два линейных дешифратора обрабатывают по 2 слова. В последнем каскаде
образуются конъюнкции вых. сигнала первого каскада. Многокаскадные
дешифраторы обладают меньшим быстродействием.



9. ПРЕОБРАЗОВАТЕЛИ С ЦИФРОВОЙ ИНДИКАЦИЕЙ


Схема устроена так, что управляющий. сигнал = 1 гасит соответствующий
элемент Z (Zn соотв Yn). Преобразователь работает в соответствии с
таблицей:

|деся-|"8421" | | | |cостояние эл-тов Z1-Z7 (Y1 - Y7) | | | | | | |
|тичн.| | | | | | | | | | | |
| |X4 |X3 |X2 |X1 |Y1 |Y2 |Y3 |Y4 |Y5 |Y6 |Y7 |
|0 |0 |0 |0 |0 |0 |0 |0 |0 |0 |0 |1 |
|1 |0 |0 |0 |1 |1 |0 |0 |1 |1 |1 |1 |
|2 |0 |0 |1 |0 |0 |0 |1 |0 |0 |1 |0 |
|3 |0 |0 |1 |1 |0 |0 |0 |0 |1 |1 |0 |
|4 |0 |1 |0 |0 |1 |0 |0 |1 |1 |0 |0 |
|5 |0 |1 |0 |1 |0 |1 |0 |0 |1 |0 |0 |
|6 |0 |1 |1 |0 |0 |1 |0 |0 |0 |0 |0 |
|7 |0 |1 |1 |1 |0 |0 |0 |1 |1 |1 |1 |
|8 |1 |0 |0 |0 |0 |0 |0 |0 |0 |0 |0 |
|9 |1 |0 |0 |1 |0 |0 |0 |0 |1 |0 |0 |



Схема преобразователя с цифровой индикацией :
[pic]


10. ПРЕОБРАЗОВАТЕЛЬ КОДА 8421 В 2421


[pic]
Код 2421 образуется из кода 8421. До 4-х он повторяет код 8421, а
дальше образуется как инверсия дополнения до 9-и. Код 8421 является двоично-
десятичным кодом, где коэффициенты 8,4,2 и 1 являются весовыми
коэффициентами, т.е. соответствуют "стоимости" каждого разряда. Сочетания:
1010, 1011, 1100, 1101, 1110, 1111
являются запрещенными. Преобразователи кодов применяются в системах
интерфейсов.



|8421 | | | |2421 | | | |
|X4 |X3 |X2 |X1 |Y4 |Y3 |Y2 |Y1 |
|0 |0 |0 |0 |0 |0 |0 |0 |
|0 |0 |0 |1 |0 |0 |0 |1 |
|0 |0 |1 |0 |0 |0 |1 |0 |
|0 |0 |1 |1 |0 |0 |1 |1 |
|0 |1 |0 |0 |0 |1 |0 |0 |
|0 |1 |0 |1 |1 |0 |1 |1 |
|0 |1 |1 |0 |1 |1 |0 |0 |
|0 |1 |1 |1 |1 |1 |0 |1 |
|1 |0 |0 |0 |1 |1 |1 |0 |
|1 |0 |0 |1 |1 |1 |1 |1 |



11. ПРОГРАММИРУЕМАЯ ЛОГИЧЕСКАЯ МАТРИЦА


(ПЛМ)

[pic]
ПЛМ является узлом ЭВМ, функционирование которого определяется
программой, записанной в него. ПЛМ может использоваться в качестве
дешифратора ПЗУ, например в МП К580, в качестве ПЗУ управляющей памяти.
При записи программы в ПЛМ прожигаются плавкие предохранители,
соединяющие транзисторы МДП с шинами матрицы. Матрица М1 называется
матрицей конъюнкции. На горизонтальные шины подаются переменные. На
вертикальных шинах образуются конъюнкции. На
вертикальных шинах появляется единичный сигнал только тогда, когда все
транзисторы, включенные в узлы матрицы и подсоединенные к этой шине
закрыты. В узлах матрицы включаются транзисторы МДП.
Прожигание программы в соответствии с назначением матрицы состоит в
том, что прожигается плавкий предохранитель и транзистор, подсоединяется к
узлу матрицы. Если на входы транзисторов подать нули, то они будут закрыты.
Матрица М2 называется матрицей дизъюнкции. На ее горизонтальных шинах
появляется сигнал в том случае, если снимать сигнал через инвертор.


12. НАКАПЛИВАЮЩИЙ СУММАТОР


Накапливающий сумматор является автоматом с памятью, т.е. слагаемые
могут приходить поочередно в произвольные моменты времени и запоминаться в
линиях задержки или в триггерах. Накапливающий. сумматор применяется в
асинхронных устройствах, в которых слагаемые не привязаны к тактам
тактового генератора.
[pic]
С приходом слагаемого аi=1 элемент "ИЛИ" устанавливается в "1",
триггер устанавливается. в "1". Если bi=1 и приходит через какое-то время
после ai, то оно запоминается в линии задержки и
одновременно bi опрокидывает триггер в "0". На инверсном выходе триггера
устанавливается "1", следовательно на вторую схему "И" подаются две
единицы, следовательно на выходе второй схемы "ИЛИ" формируется цифра
переноса в старший разряд, равная "1". Если Pi=0, то цифра суммы, которая
снимается с прямого выхода триггера, равна "0". Если Pi=1, то сумма Si=1.



|ai |bi |Pi |Si |Pi+1 |
|0 |0 |0 |0 |0 |
|0 |0 |1 |1 |0 |
|0 |1 |0 |1 |0 |
|0 |1 |1 |0 |1 |
|1 |0 |0 |1 |0 |
|1 |0 |1 |0 |1 |
|1 |1 |0 |0 |1 |
|1 |1 |1 |1 |1 |


13. ОСНОВНЫЕ МИКРОПРОЦЕССОРНЫЕ КОМПЛЕКТЫ.


Современные микропроцессоры (МП)


МП выполняет функции процессора ЭВМ, т.е. управляет процессом
управляет процессом выполнения операций и выполняет их. МП может быть
реализован на одном или нескольких кристаллах. Обычно процессор содержит
АЛУ, управляющую память. МП выбирает команду из памяти, дешифрирует,
выполняет ее, производит арифметические и логические операции, получает
данные из устройств ввода и посылает их на устройства вывода. МП вместе с
памятью и каналами ввода - вывода является ЭВМ.
МП могут быть однокристальные, многокристальные и секционированные.
Однокристальные МП изготавливаются на основе МДП - технологии, а
секционированные и многокристальные - на основе биполярных транзисторов.
МДП - транзисторы потребляют меньше энергии, но обладают меньшим
быстродействием по сравнению с биполярными транзисторами. В однокристальном
МП функции управления, операционная часть и устройство управления
реализованы на одном кристалле, а в многокристальном - на разных
кристаллах. В секционированных устройство управления, управляющая память и
АЛУ реализованы на одном кристалле, но малой разрядности. Для увеличения
разрядности следует объединять в параллель несколько МП.
МП, как функциональное устройство ЭВМ характеризуется форматом
обработки данных и команд, количеством команд, методом адресации данных,
числом внутренних регистров общего назначения (РОН), возможностями
организации и адресации стека, параметрами памяти, построением систем
прерывания программы, системами ввода - вывода, системами интерфейса.

|серия |базовая |разряд |число БИС |
| |технология | |или ИС |
|К536 |Р МДП |8 |12 |
|К580 |n МДП |8 |3 |
|К581 |n МДП |16 |4 |
|К584 |ИЛ |4n |3 |
|К586 |n МДП |16 |4 |
|К587 |К МДП |4n |4 |
|К588 |К МДП |16 |3 |
|К589 |ТТЛ ДШ |2n |8 |
|К1800 |ЭСЛ |4n |8 |
|К1801 |n МДП |16 |2 |
|К1810 |n МДП |16 |3 |
|К1883 |n МДП |8n |4 |
|КР1802 |ТТЛШ |8n |11 |
|КР1804 |ТТЛШ |4n |4 |

МП относится к числу программируемых устройств ЭВМ. МП, выполняющий
последовательность микроопераций, обладает большей логической и
функциональной гибкостью, чем жестко закоммутированные процессоры ЭВМ.
Изменяя содержимое ПЗУ и ПЛМ, можно настраиваться на выполнение требований
конкретной задачи. МП - комплект - это набор БИС, функционально сопрягаемых
и применяемых для построения микроЭВМ. В МП - комплектах К587, К588
устройство управления реализовано на основе ПЛМ. В МП - комплекте К580
имеется БИС, в которой реализован центральный процессор, устройство
управления и РОН.
Управляющая память, содержащая микропрограмму из 78 команд,
предусмотренных для данного МП, реализована на ПЛМ и находится в одной БИС
с центральным процессором и устройством управления. В МП комплекте К589
устройство управления строится в виде микропрограммного управления на базе
входящих в комплект БИС. Это позволяет реализовать потребителю требуемый
ему набор команд.
МП - комплекты К580, К586 содержат однокристальный МП.
Однокристальные МП применяются в простейших устройствах цифровой автоматики
и в качестве микроконтроллеров.
Контроллер - устройство управления вводом - выводом. Многокристальные
МП - комплекты КР1802 и секционированные КР1804 предназначены для
построения микроЭВМ и систем быстродействующей автоматики. Серия К1806,
построенная по КМОП - технологии широко применяется в радиотехническом
оборудовании судов. Она имеет сопряжение с внешней памятью на жестких
дисках с помощью контроллера, соединяющего 4 диска
Применение МП :
1. Встроенные системы контроля и управления. МП встраиваются в
оборудование, не комплектуются внешними устройствами и содержат спец. пульт
управения и ПЗУ управляющее программой
2. Локальные системы накопления и обработки информации. Локальные - т.е.
расположенные на рабочем месте системы накопления и обработки информации,
осуществляющие информационное обеспечение специалистов и руководителей.
Локальные системы, подключенные к большим ЭВМ с большим объемом памяти, что
позволяет создать автоматизированную систему информационного обеспечения.
3. Распределенные системы управления сложными объектами. В
распределенных системах схемы обработки данных и МП располагаются вблизи
источников информации (двигатели и т.д.). Они связаны с центральной
системой обработки и накопления данных.
4. Распределенные системы параллельных вычислений. В том случае, если
позволяет алгоритм решения задачи, несколько процессоров проводят
выполнения данной задачи.
МП и микроЭВМ используются в системах управления радиотехническим
оборудованием судов. Микро ЭВМ решает навигационные задачи, распознает
цели, решает оперативно - технические задачи, выполняет автоматическое
слежение за целью и т.д.


14. ТИПОВАЯ СТРУКТУРА ОБРАБАТЫВАЮЩЕЙ ЧАСТИ МП


[pic]
А - аккумулятор
СК - счетчик команд
РК - регистр команд
РАП - регистр адреса памяти
РДП - регистр данных памяти
Процесс выполнения команды состоит из 2-х циклов: цикла выборки и
исполнительного цикла. Цикл выборки начинается со считывания из счетчика
команд номера ячейки ОЗУ, содержащей код команды. После считывания
содержимое счетчика команд сразу увеличивается на 1. Номер ячейки ОЗУ
передается через регистр адреса памяти и адресную шину в дешифратор ОЗУ.
Дешифратор ОЗУ выбирает ячейку ОЗУ, содержащую код команды. Код
команды считывается из ОЗУ и через шину данных передается в регистр данных
памяти. Из регистра данных памяти код команды передается в регистр команд
где он хранится до конца выполнения команды и через аккумулятор код команды
передается в АЛУ. АЛУ анализирует код команды и если не нужно
дополнительного обращения к памяти переходит к исполнительному циклу.
Если же нужно дополнительное обращение к памяти, то МП переходит ко
второму машинному циклу, который так же начинается с цикла выборки. МП
запрашивает в ОЗУ дополнительные данные и выполняет команды.
Команды могут выполняться за 1,2 или 3 машинных цикла. В каждом
машинном цикле происходит только одно обращение к памяти. Выполнение
команды происходит под управлением сигналов, вырабатываемых устройством
управления. При выполнении команды АЛУ взаимодействует с РОН. РОН
используются для кратковременного хранения операндов и результатов.
Триггеры состояния сигнализируют о следующих состояниях МП: обнуление
аккумулятора, содержимое знакового разряда, переполнение разрядной сетки,
цифры переносов из 8-го и 4-го разрядов, содержимое разряда контроля на
четность и нечетность. Адресная шина является однонаправленной, а шина
данных - двунаправленной. СТЕК - особый вид памяти, расширяющий
функциональные возможности МП. Например при выполнении прерывающей
программы в СТЕК помещается номер команды возврата и результат выполнения
последней команды перед переходом к выполнению прерывающей программы.


15. МИКРО ЭВМ НА БАЗЕ МП К580


[pic]
Чтобы построить микроЭВМ надо дополнить МП БИСами памяти, УВВ
интерфейса, причем они должны сопрягаться с МП по входным и вых. сигналам,
по принятому коду для данного МП. При выполнении программы, программа
хранится в ОЗУ. Если набор действий МП при выполнении программы ограничен и
однообразен, как например в системах управления станков с ЧПУ, то
программа хранится в ПЗУ. Если объем памяти ОЗУ недостаточен, то программа
может хранится во внешнем запоминающем устройстве, например в магнитном
носителе информации.
[pic]
Процесс выполнения программы МП связан с тактами генератора тактовых
импульсов (ГТИ). МП работает в синхронном режиме. ГТИ создает две
импульсных последовательности Ф1 и Ф2 амплитудой 12 В и частотой 2МГц. В
такте t1 импульсной последовательности Ф1 счетчик команд МП посылает через
шину адреса номер ячейки ОЗУ, ПЗУ или УВВ, содержащих код команды. В такте
t2 МП ждет сигнал "готовности" от ОЗУ. Этот сигнал означает, что дешифратор
ОЗУ выбрал нужную ячейку и код команды считан. Если сигнал "готовность" не
приходит, то такт t2 повторяется до тех пор, пока сигнал не придет. В такте
t3 МП принимает код команды и передает его в АЛУ. В такте t4 код команды
анализируется и если ненужно дополнительное обращение к памяти, то в такте
t5 команда выполняется. Если такое обращение необходимо, то тактом t4
заканчивается 1-й машинный цикл. Начинается 2-ой машинный цикл тактом t1, в
котором происходит обращение к памяти. В такте t2 второго маш. цикла МП
ждет сигнала готовности от ОЗУ и в такте t3 выполняет команду. В каждом
машинном такте происходит только одно обращение к памяти.
Последовательность Ф2 используется для формирования синхроимпульсов на фоне
которых формируется строб состояния.

16. ФОРМАТЫ КОМАНД И СПОСОБЫ АДРЕСАЦИИ


Формат команды определяется разрядностью МП. У МП К580, который
является 8-ми разрядным, однобайтовые команды имеют формат 8 разрядов, 2-х
байтовые -16, 3-х байтовые -24. Команда должна содержать код операции,
адрес первого и второго операнда, адрес результата, адрес следующей
команды. МП К580 является 8-ми разрядным, поэтому необходимо сократить кол-
во данных, содержащихся в коде команды. Один из операндов всегда помещается
в аккумулятор, поэтому его адрес не указывается. Результат помещают по
адресу одного из операндов, адрес тоже не указывают. Адрес следующей
команды формируется добавлением единицы к содержимому счетчика команд, т.к.
команда программы записывается в последовательных ячейках ОЗУ. Код команды
должен содержать код операции и адрес 1-го из операндов. Кол-во операций
значительно меньше чем кол-во команд. Это объясняется тем, что операнд
может быть помещен в РОН, ячейку ОЗУ или содержится в самой команде. В МП
К580 используются следующие способы адресации операнда:
1. Прямая, при которой в коде команды указывается номер РОН,
содержащего операнд:

|мнемоника |кодовая |выполняемая |
|команды |комбинация |операция |
|MOV C, D |01 001 010 |C (D) |
|ADD D |10 000 010 |A (A)+(D) |

Первая команда - команда пересылки содержимого регистра D в регистр C
. Регистры общего назначения: B, C, D, E, H, L, ячейка памяти М и
аккумулятор А при обращении к ним имеют номера:

01 - код операции
001 - номер регистра С
010 - номер регистра В

|B |000 |
|C |001 |
|D |010 |
|E |011 |
|H |100 |
|L |101 |
|M |110 |
|A |111 |

Вторая команда - сложение содержимого регистра D с содержимым
аккумулятора и результат помещается в аккумулятор.

10000 - код операции
010 - номер регистра D

2. Непосредственная адресация
Операнд указывается во втором, или во втором и третьем байтах команды.

а. Сложение ADI B1 11 000 110 А (A)+(B2)
B2 01 001 100 (B2)=4C (16)

б. Пересылка MVID B1 00 010 110 D (B2)
B2 01 001 110 (B2)=4E (16)

в. Загрузка LXID B1 00 010 011 D (B3); E (B2)
B2 01 100 101 (B2)=65 (16)
B3 10 100 101 (B3)=A5 (16)

3. Косвенная адресация
В коде команды указывается номер регистра РОН, содержащего номер ячейки
ОЗУ, содержащей операнд :

LDAX B 00 001 010 A [(BC)]
STAX B 00 000 010 [(BC)] (A)


17. ЦЕНТРАЛЬНЫЙ ПРОЦЕССОРНЫЙ ЭЛЕМЕНТ К580


[pic]
МП К580 - однокристальный, 8-ми разрядный, основан на принципе
управления жесткой логики. РОН В, C, D, E, H, L, устройство управления и
операционная часть реализованы в одном кристалле. 6 регистров общего
назначения и аккумулятор являются программно доступными, т.е. при
написании программы программист может к ним обращаться. Регистры W, Z и
буферные регистры являются программно недоступными, т.е. они участвуют в
выполнении программы, но программист к ним обратиться не может. РОН
являются 8-ми разрядными. Если операции совершаются над 16-ти разрядными
операндами, то РОН объединяются попарно. Регистры указателя стека, счетчик
команд и регистр адреса являются 16-ти разрядными. Указатель стека содержит
номер верхней занятой ячейки стека. При записи информации в стек содержимое
указателя стека уменьшается на 1, а при считывании увеличивается на 1.
Счетчик команд содержит номер ячейки ОЗУ, содержащей следующую команду. При
считывании из счетчика команд номера ячейки команд содержимое счетчика
увелич. на 1.
Регистр адреса служит для передачи содержимого счетчика команд через
шину адреса и буфер адреса в ОЗУ.
Устройство управления содержит регистр команд, дешифратор команд и
управляющее устройство, в которое входит ПЛМ, содержащая управляющую
память.
Управляющая память содержит микропрограммы всех 78-ми команд для данного
МП. АЛУ дополняется схемой десятичной коррекции для действий над двоично-
десятичными числами. При действиях над двоично - десятичными т.е. при
использовании кода 8421 максимально допустимая комбинация 1001 (т.е.9), но
при использовании 4-х двоичных разрядов максимально возможное число 1111
(т.е.15). Схема десятичной коррекции отнимает 6 и формирует цифру переноса
в старший разряд. На управляющее устройство поступают последовательности Ф1
и Ф2 тактового генератора, сигнал готовности от ОЗУ, ПЗУ или УВВ к приему
или передаче данных. Сигнал запроса на прерывание от внешних запоминающих
устройств. Сигналы захвата, сброса так же формируются ВЗУ. МП формирует
сигнал разрешение прерывания и продолжает выполнять текущую команду и по
окончании текущей команды МП переходит к удовлетворению запроса о
прерывании. Сигнал ожидания, сформированный МП означает, что он ждет
сигнала готовности от ОЗУ, ПЗУ или ВЗУ. Регистр признаков является 5-ти
разрядным. Он сигнализирует о следующем состоянии МП - обнуление,
переполнении разрядной сетки, содержимое знакового разряда, содержимое
разряда контроля на четность - нечетность и формирование цифры переноса из
8-го и 4-го разряда.


18. СИСТЕМА СБОРА ДАННЫХ НА БАЗЕ МП К580


Эта система предназначена для последовательного опроса 8-ми
аналоговых датчиков и передачи информации в ОЗУ. Опрос датчиков
преобразования аналоговой информации в цифровую, запись информации в ОЗУ
производится под управлением МП.
[pic]
Номер опрашиваемого датчика формируется в одном из РОН, в основном в
регистре В. В 8-ми разрядном регистре в 5-ти старших разрядах записываются
единицы, а в трех младших разрядах - номер датчика. Первоначально в
регистре В записано число F8 в 16-тиричной системе исчисления:
11111000=F8
001
010
При опросе каждого датчика содержимое регистра В увеличивается на 1.
При опросе последнего датчика в регистре записывается число FF = 11111111.
[pic]
Добавление следующей 1 обнуляет регистр В. На выходе триггера нуля TZ
появляется 1. Номер ячейки ОЗУ, в которую должен быть записан результат
опроса датчика, содержится в паре РОН, например, в регистрах HL.
Алгоритм работы системы сбора данных:
например будем считать, что первая занятая ячейка ОЗУ имеет номер 1350 в
шестнадцатиричной системе. В нее будет помещен результат опроса 1-го
датчика с номером 000. Через аккумулятор и шину данных номер датчика
подается на устройство вывода 1 (УВ1). УВ1 подает номер датчика на
коммутатор. Коммутатор опрашивает нужный датчик и передает аналоговый
сигнал на АЦП. АЦП преобразует аналог. сигнал в цифровой и передает
цифровой сигнал на УВВ1. Если в первом такте импульсной последовательности
Ф1 МП передает номер датчика, то во втором такте он ожидает прихода сигнала
окончания преобразования от АЦП. Сигнал окончания равный 1 передается через
УВВ2, через шину данных в аккумулятор. Наличие сигнала окончания
аккумулятор проверяет операцией циклического сдвига вправо. Если сигнал
окончания пришел, то при сдвиге вправо 1 из младшего разряда аккумулятора
передается в триггер сдвига ТС, триггер сдвига опрокидывается в состояние 1
и данные из устройства ввода 1 по шине данных передаются в аккумулятор, а
из него в ячейку ОЗУ. Содержимое пары регистров HL и регистра В
увеличивается. на 1, при этом формируется номер следующего датчика и номер
ячейки, куда должен быть помещен следующий результат.


19. ЦЕНТРАЛЬНЫЙ ПРОЦЕССОРНЫЙ ЭЛЕМЕНТ (ЦПЭ) К589


МП. комплект К589 построен по принципу микропрограммного управления,
т.е. один и тот же набор микросхем выполняет разные функции при решении
задачи в зависимости от микропрограммы, записанной в ПЗУ. Микропроцессорный
комплект К589 является многосекционным, т.е. каждая 2-х разрядная секция
центрального процессорного элемента содержит АЛУ и РОН. Т.к. МП является 2-
х разрядным, то для обработки многоразрядных данных необходимо объединить в
параллель несколько ЦПЭ. ЦПЭ К580 является асинхронным устройством.
Синхронизирующий сигнал "С" необходим только для открывания триггеров РОН.
Обработка информации производится в АЛУ. Данные в АЛУ поступают
через мультиплексоры А и В. Для временного хранения информации используются
регистры общего назначения R0...R9, аккумулятор и регистр "Т", близкий по
функциям к аккумулятору. Выбор регистра, на который передается информация,
осуществляется с помощью демультиплексора. Информация с регистров
передается через мультиплексор. Мультиплексор А передает на вход АЛУ или
данные с шины данных М0 М1 или с вых. аккумулятора. или с одного из РОН.
Мультиплексор В передает на вход АЛУ поразрядные конъюнкции данных с
внешней шины В2 В0 и шины К1 К0 или данных с вых. аккумулятора. К1 К0 или
константы с К1 К0. Шина К1 К0 служит для выделения или маскирования
(запрета) какого - либо разряда данных с вых. аккумулятора. или с шины В1
В0.
Работа ЦПЭ осуществляется в соответствии МК ЦПЭ F6...F0, которая
является. частью МК микро ЭВМ. Т.к. для обработки данных АЛУ объединяются
параллельно, то АЛУ должно формировать сигналы сдвига вправо (входной -
СП1, выходной - СП0) и сигнал переноса (входной - С1, выходной - С0).
Сигналы X и Y управляют схемой ускоренного переноса, в которой
формируется цифра переноса одновременно с образованием суммы разрядов
чисел.
Выходной буфер ВБ3 открыт только при подаче цифры переноса, в
остальных случаях открыт вых. буфер ВБ4. Выходные данные из 2-х разрядного
регистра адреса и 2-х разрядного аккумулятора передаются через вых. буферы
1 и 2 на шину адреса А1 А0 и на шину данных Д1 Д0 только при подаче
сигналов разрешения выдачи адреса ВА и выдачи данных ВД.
При наличии высокого уровня синхросигнала (1) триггеры открыты для
приема информации. На отрицательном. фронте синхросигнала происходит
передача данных с выходных триггеров.


20. БЛОК МИКРОПРОГРАММНОГО УПРАВЛЕНИЯ (БМУ).


[pic]

Структура микрокоманд.

Из ОЗУ в блок микропрограммного управления (БМУ) поступает код
команды, содержащий адрес первой микрокоманды (МК) микропрограммы
выполнения данной команды. Эта микропрограмма записана в управляющей
памяти, входящей в состав устройства управления. По указанному адресу
считывается из управляющей памяти МК для всего микропроцессорного
устройства. Эта МК содержит МК СРП БМУ, микрокоманду ОЗУ, МК устройства
ввода - вывода.

|МК |МК |МК |МК |... |
|ЦПЭ |БМУ |ОП |УВВ | |

Сформированные МК передаются на соответствующие узлы микропро-
цессорного устройства. БМУ служит для формирования адреса следующей МК.
Если нет никаких условных переходов, то следующая МК считывается из
следующей ячейки ПЗУ, на котором организована управляющая память. МК БМУ
содержит поле условных переходов УА6...УА0, в котором записывается адрес
следующей МК; поле управления признаками УФ3...УФ0 и поле управления
загрузкой микрокоманды ЗМ.
Поле управления признаками указывает вид перехода: условный,
безусловный и способ формирования адреса следующей МК при наличии условного
перехода. Управляющие сигналы для управления признаками - это сигнал
переноса и сигнал сдвига вправо. При наличии в поле управления загрузкой ЗМ
= 1, адрес МК загружается в регистр адреса МК. МК БМУ:

|Поле условных переходов |Поле управления |Поле управления загрузкой|
|YA6 ... YA0 |признаками УФ3 ... УФ0 |ЗМ |


МК операционного устройства содержит код микрооперации F6...F4, номер
регистра общего назначения F3...F0, который является приемником или
источником информации. Маскирующий сигнал К, в общем случае является
двухразрядным, ВА - сигнал разрешения выдачи адреса и ВД - сигнал
разрешения выдачи данных. МК ОУ:

| | | | | |
|F6...F4 |F3...F0 |K |BA |ВД |


21. СТРУКТУРНАЯ СХЕМА И ПРИНЦИП ДЕЙСТВИЯ


БЛОКА МИКРОПРОГРАММНОГО УПРАВЛЕНИЯ (БМУ)


[pic]
На входы K7...K0 БМУ подается код команды, который является адресом
первой микрокоманды (МК) микропрограммы выполняемой команды.
По сигналу ЗМ=1 адрес первой команды загружается в регистр адреса
МК. Регистр позволяет адресовать 4-х разрядный номер колонки (16
колонок) и 5-ти разрядный. номер строки (32 строки).
Код К7...К0 - 8-ми разрядный, поэтому первоначально в старшем
разряде номера строки записывается 0. Такая разрядность регистра адреса
МК позволяет адресовать 512 ячеек ПЗУ, расположенных в 16-ти колонках и
32-х строках.
В первой МК БМУ содержится способ формирования адреса следующей
МК. Поля УА6...УА0 первой МК подаются на логическую схему определения
адреса следующей МК. Сформированный схемой адрес подается в регистр
адреса МК и через выходные буферы 1 и 2 на адресную шину, связывающую БМУ с
управляющей памятью.
Считывание номера колонки с вых. буфера 1 происходит при подаче на
вход "общий строб" единицы.
Считывание номера строки через выходной буфер 2 происходит при
подаче "1" на входы "общий строб" и "разрешение строки". Команда БМУ в
поле УА6...УА0 в старших разрядах содержит вид перехода, а в младших номер
строки или столбца. Например первая команда JCC - команда безусловного
перехода в текущей колонке содержит в разрядах УА6 и УА5 указания вида
перехода, в остальных разрядах номер строки, номер колонки не изменяется.
Вторая команда JZR - команда безусловного перехода в нулевую строку. В
разрядах УА6...УА4 указывается вид перехода, в остальных разрядах - номер
колонки, а в адресе строки указывается нулевая строка. Если при
выполнении команды JZR приходим к ячейке с адресом (0,15), т.е. нулевая
строка, 15-ая колонка, вырабатывается сигнал строб разрешения прерывания.
Этот сигнал подается на блок приоритетного прерывания (БПП), и если до
этого поступил запрос на прерывание, то выход строк БМУ отключается от ПЗУ
и на ПЗУ подается номер первой строки первой команды прерывающей
команды. Если запроса на прерывание не было, продолжает выполняться
основная программа и на входы К7...К0 подается код следующей команды.
Признаки участвуют в формировании адреса следующей МК при условных
переходах. Признаки, такие как сдвиг вправо и цифра переноса подаются от
центрального процессорного элемента (ЦПЭ) по единой шине на вход Ф
триггера признаков. В поле признаков содержится сигнал УФ0...УФ1, по
которым признак записывается в регистр признаков и сигналы УФ2 УФ3, по
которым признак считывается из регистра признаков через выходной буфер 3 на
выход Фв, с которого они подаются на вход ЦПЭ.
В третьей команде условного перехода JFL по содержимому триггера
признаков младший разряд номера колонки равен содержимому триггера
признаков.


22. БЛОК ПРИОРИТЕТНОГО ПРЕРЫВАНИЯ (БПП)


Каждой команде соответствует микропрограмма, состоящая из отдельных
микрокоманд (МК). На входы К7...К0 БМУ подается код команды, который
является адресом первой МК микропрограммы данной команды в управляющей
памяти. 1-ая МК содержит указания, как формировать адрес второй МК. Этот
адрес формируется логической схемой определения адреса следующей МК.
Последняя МК каждой микропрограммы содержит указание JZR о переходе в
нулевую строку 15-ой колонки. По этому адресу содержится МК, в поле ЗМ
которой содержится "1". К этому времени на входах К7...К0 поступает код
следующей команды, который по сигналу ЗМ=1 загружаются в регистр адреса
МК (РАМК). Так происходит выполнение программы в отсутствие прерываний.
На выходе прерывания (ПР) БПП формируется сигнал, при этом
устанавливается такой уровень, что мультиплексор М передает номер строки с
выхода БМУ на вход Астр ПЗУ. При выполнении JZR (переход по адресу (0,15)
) формируется сигнал строб разрешения прерывания равный "1", который
подается на вход БПП. Если во время выполнения текущей программы
поступил запрос на прерывание, то микропроцессор, выполнив текущую команду
передает в стек номер следующей команды (команда возврата) и результат
выполнения текущей команды.
При наличии "1" на входе строб разрешения прерывания (СРП) и
запроса на входе запроса (ЗП), БПП на выходе прерывания вырабатывает
сигнал, отключающий мультиплексор М от выхода МА1..МА4 подает номер строки
в ПЗУ с выхода код прерывания (КП) БПП.
Первая МК первой прерывающей команды содержит код адреса (31,15), где
15 - номер колонки, который сохранился при выполнении последней МК текущей
команды, а 31 = 11111(2) номер строки в 15-ой колонке, который образуется
подачей +5В через резистор на входы Астр ПЗУ. Блок БПП содержит специальный
блок уровня приоритета. Приоритет кодируется 3-х разрядным кодом.
Преимущество имеет устройство с более низким уровнем приоритета. Если
поступил запрос сразу от нескольких устройств, то устройство сравнения
приоритета выявляет более низкий уровень и этот запрос удовлетворяется
первым. По окончании прерывания программы последняя МК, которой является
JZR (переход по адресу (0,15) ) по сигналу ЗМ = 1 загружается очередная
команда основной программы.

23. СХЕМА УСКОРЕННОГО ПЕРЕНОСА (СУП)


[pic]
Предназначена для формирования цифры ускоренного переноса параллельно
с суммированием операндов в ЦПЭ. Цифра переноса формируется в СУП в том
случае, если ai и bi равны 1. ЦПЭ в этом случае вырабатывает сигнал Yi = ai
bi = 1. Или если один из операндов и цифра переноса из младшего разряда
равны единице, то :

[pic]

В том случае, если Xi и Pi равны 1, цифра переноса в старший разряд -
1.
Условие формирования цифры переноса :

[pic]


24. СХЕМА ОДНОРАЗРЯДНОГО СУММАТОРА С ФОРМИРОВАНИЕМ ЦИФРЫ ПЕРЕНОСА В СУП



[pic]
Цифра переноса поступает по общему входу переноса и сдвига вправо с
выхода регистра признаков БМУ. Цифра переноса подается в схему ускоренного
переноса и в младший разряд младшего ЦПЭ. В данной схеме объединены 8 ЦПЭ
для обработки 16-ти разрядных данных. Сдвиг вправо передается сквозным
переносом между центральными процессорными элементами. Цифра переноса
формируется в СУП одновременно с суммированием операндов в ЦПЭ. Сдвиг
вправо из младшего разряда и цифра переноса из старшего разряда старшего
ЦПЭ передается на объединенный выход переноса, который соединяется с входом
признаков БМУ. Последняя цифра переноса может формироваться как в последнем
ЦПЭ, так и в СУП, в зависимости от того, какой сигнал подается на вход
разрешение переноса (РП). Если РП = 1, то цифра переноса снимается с выхода
СУП, а если РП = 0, то с ЦПЭ.
За счет применения СУП время выдачи переноса С9 из старшего разряда
старшего ЦПЭ сокращается до 20 нс.


25. ОРГАНИЗАЦИЯ ПАМЯТИ ЭВМ


Память ЭВМ организована по иерархической лестнице, т.е. устройства
обладающие большим объемом памяти обладают меньшим быстродействием.
Наибольшим быстродействием обладают СОЗУ (сверх ОЗУ). Они обычно
реализуются на регистрах, поэтому в МП СОЗУ называется РОН. Объем памяти
СОЗУ очень мал. Обычно памятью машины называют ОЗУ. Быстродействие ОЗУ
должно быть не меньше чем быстродействие электронных схем операционной
части, памяти должно быть достаточно для записи программы решаемой задачи,
а так же исходных данных, промежуточных и конечных результатов. Внешние
запоминающие устройства обладают практически неограниченным объемом памяти
и наименьшим быстродействием. ОЗУ не сохраняет информацию при отключении
питания. Существуют ПЗУ, которые сохраняют информацию при отключении
питания. ПЗУ работают только в режиме чтения, а ОЗУ в режиме чтения и
записи. Существуют перепрограммируемые ПЗУ (ППЗУ), которые сохраняют
информацию при отключении питания и допускают запись информации. При этом
время записи во много раз больше времени считывания. Считывание информации
из ОЗУ может происходить с разрушением информации или без.
При разрушении информации при считывании необходимо дополнительное
время на восстановление информации. Время считывания состоит из времени
поиска адреса, времени собственного считывания и времени регенерации
(восстановления) считанной информации. ОЗУ реализуется на микросхемах.
Элемент памяти реализован на триггерах. Триггер может быть построен на
биполярных и униполярных транзисторах.

[pic]
По шине адреса (ША) в регистр адреса поступает n - разрядный двоичный
код адреса. n1 разряд используется для записи номера строки, а n2 - для
записи номера столбца. Дешифраторы строк и столбцов вырабатывают
управляющие сигналы на соответствующих выходах. Под действием этих
управляющих сигналов происходит выбор адресуемого элемента памяти, если на
входе выбора кристалла (ВК) дешифратора строк "1", то ОЗУ находится в
режиме хранения. Если на ВК "0", то ОЗУ находится или в режиме чтения, или
в режиме записи. Нормальным является режим чтения. Информация поступает
через усилитель чтения (УЧ) и выходной триггер.
[pic]
Режим записи обеспечивается подачей сигнала разрешения записи (РЗ) на
усилитель записи (УЗ). Информация через триггер и УЗ подается на
информационные цепи 1 и 0. Триггеры реализованы на МДП - транзисторах.
Транзисторы VT2 и VT4 являются нагрузкой триггера. Напряжение затвор -
исток этих транзисторов имеет нулевое значение, поэтому они всегда открыты.
Триггер реализован на VT1 и VT3. В нем записана "1", если VT1 закрыт. При
совпадении сигналов от дешифратора строк и столбцов триггер готов к записи
или считыванию информации. Управляющий сигнал с выхода дешифратора столбцов
действует на VT7 и VT8. Управляющий сигнал с выхода дешифратора строк
воздействует на VT5 и VT6.
Запись "1" производится в том случае, если на информационную цепь
(ИЦ) нуля поступает логический "0". Для записи "0" логический "0" подается
в ИЦ1.
В режиме чтения состояние триггера передается через открытые VT5-VT8
в информационные цепи. Если элемент памяти хранит "1", то уровень "1"
поступает в ИЦ1, а если "0", то уровень логической "1" поступает в ИЦ0.


26. ПОСТОЯННЫЕ ЗАПОМИНАЮЩИЕ УСТРОЙСТВА


(ПЗУ)


Отличается от ОЗУ тем, что в него информация записывается однократно.
Для ПЗУ возможен только режим чтения. Информация из ПЗУ считывается
пословно. В одной строке записывается несколько слов. Выбор слова в строке
производится с помощью селектора. Селектор собран на VT0 - VT7. Буфер ввода
- вывода собран на многоэмиттерных транзисторах МТ1 - МТ4. Ввод и вывод
кодов слов производится с одних и тех же выходов: 1, 2, 3, 4. Т.к. ввод
производится однократно, то все остальное время эти входы используются для
вывода.
[pic]
На дешифратор строк передается 5-ти разрядный номер строки,
содержащий восемь четырех разрядных слов. С дешифратора слов номер слова
передается на селектор. Например, пусть выбрана (1) строка и (0) слово.
Необходимо записать со второго входа "1". Транзистор МТ2 откроется. Ток
этого транзистора протекает через резистор R"о и закрывает 2-ой транзистор
в выбранной "четверке". Таким образом состояние транзистора определяется
записанным разрядом: при записи "1" - закрыт, при записи "0" - открыт.
Затем повышают напряжение коллекторного питания накопителя. Через открытый
транзистор потечет повышенный ток, который прожжет перемычку, которая
изготовлена из нихрома с сопротивлением в несколько десятков Ом. Для их
прожигания достаточен ток 20-30 мА. Перед записью слов опорное напряжение,
подаваемое на многоэмиттерные транзистор увеличивается с тем, чтобы
транзистор находился в состоянии, близком к закрытому. При чтении
информации также происходит выбор слова и если перемычка в транзисторе не
прожжена, то ток этого транзистора создает падение напряжения на Ro,
которое закрывает многоэмиттерный транзистор. Состояние многоэмиттерного
транзистора определяет код на выходе. Таким образом программу прожигает
пользователь.


27. ВНЕШНИЕ ЗАПОМИНАЮЩИЕ УСТРОЙСТВА (ВЗУ)


ВЗУ вместе с устройствами ввода - вывода относятся к периферийным
устройствам. Периферийные устройства обеспечивают общение человека с
машиной. Раньше роль ВЗУ выполняли перфокарты и перфоленты. В настоящее
время используются магнитные носители информации: магнитные ленты и диски.
Магнитная лента относится к запоминающим устройствам с последовательным
доступом к памяти. Магнитные диски относятся к запоминающим устройствам с
произвольным доступом, т.е можно записывать и считывать информацию сразу по
заданному адресу. При записи информация наносится на магнитный носитель,
движущийся под головкой записи. В соответствии с записанным кодом
происходит намагничивание элементарных участков магнитной поверхности. При
считывании в обмотке считывания наводится ЭДС при пересечении магнитной
головкой границ элементарных участков. В магнитных лентах информация
записывается перпендикулярно направлению движения. Для записи информации
используются методы записи без возврата к нулю и фазовой модуляции. Для
записи информации на магнитные диски используется метод частотной
модуляции.

[pic]

27.1 Метод записи без возврата к нулю

состоит в том, что полярность сигнала меняется только при записи "1",
следовательно в обмотке считывания наводится ЭДС только в том случае, если
считывается единичный сигнал. Наличие импульса любой полярности в обмотке
считывания означает "1", а отсутствие импульса "0". Этот метод обеспечивает
невысокую плотность записи 8 и 32 бит/мм. При считывании возможна ошибка,
когда отсутствие информации будет принято за "0". Чтобы избежать этой
ошибки необходимо подавать синхроимпульсы по специальной дорожке. Если есть
только синхроимпульс - "0", а если синхроимпульс и еще один импульс, то
записывается "1".

27.2 Фазовая модуляция.


[pic]
Метод фазовой модуляции состоит в том, что "1" и "0" передаются
разной фазой, например "1" - перепад от минимума к максимуму, а "0" -
наоборот. В устройстве воспроизведения есть специальный блок,
анализирующий, какой следующий знак должен быть записан. Если должны быть
записаны два одинаковых знака, то в середине такта делается дополнительный
перепад с тем, чтобы сначала следующего такта был нужный перепад.
Распознование единиц и нулей производится по импульсам вначале такта. Если
записана "1", то в обмотке считывания в начале такта импульс отрицательный.
Этот метод является самосинхронизирующимся, т.к. в начале каждого такта
есть импульс - положительный или отрицательный. Плотность записи 32 и 63
бит/мм.

27.3 Частотная модуляция (ЧМ).

[pic]
При ЧМ "1" передается сигналом с частотой в 2 раза больше, чем при
передачи "0". Этот метод является самосинхронизирующимся, т.к. в начале
каждого такта есть импульс. При этом методе обеспечивается высокая
плотность записи 63 бит/мм. Распознование "1" происходит при наличии
импульса в середине такта.


[pic]

28. УСТРОЙСТВА ВВОДА - ВЫВОДА ИНФОРМАЦИИ

1. Устройства ввода
предназначены для ввода данных и программ, а также для внесения
исправлений в программу и данные, хранящиеся в памяти ЭВМ. Подразделяются
на неавтоматические (ручные) и автоматические. Автоматические
характеризуются тем, что в них информация вводится с промежуточного
носителя информации: с перфолент, перфокарт, магнитных носителей, с
напечатанных текстов и графиков, с человеческой речи. Их быстродействие
выше, чем у ручных. Ручные устройства отличаются меньшим быстродействием,
но позволяют корректировать информацию в процессе ввода. К ним относятся
различные клавиатуры, пульты управления.


Новинки рефератов ::

Реферат: Сексуальная символика в культуре (Искусство и культура)


Реферат: Контроль і ревізія (Бухгалтерский учет)


Реферат: Новочеркасское восстание 1962 (История)


Реферат: Донской монастырь (История)


Реферат: Рабочее место технического дизайнера (Трудовое право)


Реферат: В.А.Моцарт - Биография и анализ творчества (Музыка)


Реферат: Рапс, выращивание и перспективы в РБ (Сельское хозяйство)


Реферат: Принцип работы лазера и его применение (Естествознание)


Реферат: Предмет криминологии (Криминология)


Реферат: Культурное развитие Византии (История)


Реферат: Лаврентий Павлович Берия (Исторические личности)


Реферат: Анализ внешней среды и выработка стратегии взаимодействия (Теория организации)


Реферат: Истинное солнечное и среднее солнечное время. Местное и всемирное время. Поясное, декретное время (Астрономия)


Реферат: Средства и техника педагогического общения (Педагогика)


Реферат: Управление рисками (Управление)


Реферат: Несанкционированный доступ к терминалам серверов с операционными системами семейства UNIX. На примере octopus.stu.lipetsk.ru (Компьютеры)


Реферат: А.П. Чехов и его произведения: "Унтер Пришибей", "Палата N6", "Дом с мезонином" (Литература)


Реферат: Влияние стресса на организм (Психология)


Реферат: Курсовая работа по систематике растений "Урбанизированная экосистема" (Ботаника)


Реферат: Голосование избирателей: выборы, референдум (Право)



Copyright © GeoRUS, Геологические сайты альтруист